解决多核设计挑战并且提供安全支持

开发多核 ASIC 的关键挑战包括管理复杂性、功耗优化、核间通信、同步、验证、测试和性能优化,同时确保可扩展性、可靠性和集成的简易性。

Ncore™ 通过提供经量产验证过、高度可配置且高效的一致 NoC 互连 IP 解决方案来解决这些挑战,该解决方案可与多种协议和包括 ArmRISC-V 在内的任何处理器配合使用。Ncore 经过精心设计,支持 ISO 26262 设计,从而提供了独特的价值,一旦获得认证,将确保在符合功能安全要求的安全关键型应用中可靠运行。

在 ASIC 设计中结合使用 Ncore IP 和 FlexNoC IP 可实现无与伦比的性能优化、可扩展性和系统集成,实现强大的缓存一致性、高效通信和灵活性,从而实现市场差异化并加快产品上市时间。

SoC Developers

唯一的多协议 AMBA CHI-B、CHI-E 和 ACE 缓存一致性 NoC

帮助 SoC 开发人员创建高性能一致性SoC

可扩展

可扩展

Ncore 提供高带宽、低延迟的互连结构,实现 SoC 不同组件之间的高效通信,提供从小型嵌入式系统到大型数十亿晶体管设计的可扩展性能和功耗效率。

可配置

可配置

多种协议一致性的支持为已有和未来的 IP 支持提供了选择和复用。连接到同一个 Ncore上的,发起传输的IP 可以遵守的是不同的一致性协议,包括(CHI-E、CHI-B 和 ACE 以及 ACE-Lite IO )。Ncore 还允许 AXI 非一致性代理充当 IO 一致性代理。

安全

安全

通过外部评估员的 ISO 认证,确保 Ncore 可用于符合 ISO 26262 标准的芯片,根据安全性和可靠性产品选项,可提供的 ASIL B 到 ASIL D 要求。针对您的 Ncore 配置自动生成故障模式、影响和诊断分析 (FMEDA) 数据。

Ncore 主要功能

  • 高度可扩展的系统
  • 支持混合AMBA CHI和AMBA ACE的真正异构一致性
  • 对于缓存处理器的完全一致性和对加速器的I/O一致性
  • 可配置网络和拓扑
  • 通过物理瓦格化重复块的网格拓扑
  • 功能安全,包括 FMEDA 生成和 ASIL D 认证
  • 可配置的探听过滤器
  • I/O缓存和系统内存缓存
  • 更低功耗
  • 服务质量 (QoS)
  • 调试和跟踪/监控
Ncore 主要功能

特点

NoC 瓦格化(tiling)- Ncore 的新功能

在网格拓扑中,瓦格化可以支持到256个 CPU 分布到32个簇中

  • 性能扩展
  • 缩短设计时间
  • 速度测试
  • 减少设计风险
  • 支持 Arm 和 RISC-V 架构

创建模块化、可扩展的设计,实现更快的集成、验证和优化。

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NoC 瓦格化(tiling)- Ncore 的新功能

Ncore 产品优势

频率高,延迟时间短

频率高,延迟时间短

使用多个可配置的探听过滤器来适应不同的缓存组织

低功耗

低功耗

减少片外主存访问,从而降低功耗

较小的芯片面积

较小的芯片面积

使用最佳 NoC 传输层减少线路

配置简单

配置简单

Ncore 适应每个一致性代理的行为和特征

更快的上市

更快的上市

瓦格化(tiling)加速物理设计、实现和时序闭合

灵活的拓扑

灵活的拓扑

可选择crossbar、网格和ad-hoc拓扑

安全

安全

自动化FMEDA安全文档,符合ISO26262 ASIL B到D认证

自动验证

自动验证

通过自动生成验证,可以节省数百个小时的工时

缩短项目周期

缩短项目周期

更少的迭代循环

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客户评价
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